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FPGA/ASIC
DigitalTrafficController
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项目作者:
wenzhengxing
项目描述 :
curriculum design of digital logic
高级语言:
Verilog
项目主页:
项目地址:
git://github.com/wenzhengxing/DigitalTrafficController.git
创建时间:
2017-02-17T04:30:32Z
项目社区:
https://github.com/wenzhengxing/DigitalTrafficController
开源协议:
GNU General Public License v3.0
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